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Wire FPGA (beta)
説明 スレッド6 コメント21 変更履歴
17件中 11-17 を表示
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更新：2021年2月9日 @ 11時06分

Added Execute On options to FPGAs, allowing you to chose when they should execute
Added node colors
Added FPGA help
Added new gates - Execution Delta, Previous, Self, Owner


Fixed wiring bug with entities

Refactored some gate related code

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更新：2021年2月8日 @ 7時24分

Fixed significant bug where you couldn't create or remove nodes after editing chip name

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更新：2021年2月7日 @ 13時45分

Added colored connections
Added new "CPU" gate category, right now with bit conversion gates (4 bit, 8 bit and 16 bit)

Modified edit (constant and input/output) behaviour to be much more user friendly
Massively improved performance monitoring, and fixed various bugs related to performance monitoring

Fixed problem where chips would only run through their node queue 50 times, causing partial executions with big chips
Fixed bug where you couldn't create new file via file browser

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更新：2021年2月6日 @ 6時45分

Updated logo

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更新：2021年2月5日 @ 14時14分

Added example file (_helloworld_.txt)
Updated clientside node validation such that nodes can't be connected to themselves
Changed default execution interval from 0.015s to 0.1s

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更新：2021年2月5日 @ 5時55分

Removed unnecessary tool_loader.lua

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更新：2021年2月5日 @ 5時07分

Initial addon creation.

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